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Allegro元器件疊加報DRC錯誤問題

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發(fā)表于 2017-3-25 12:54:12 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
    我在學習 allegro 2層IPTV網(wǎng)絡電視主板pcb設計全程實戰(zhàn)視頻 的 2.2 PCB布局：PCB模塊布局與優(yōu)化 課程是
6 J" r2 m/ X1 z$ ?( P! i遇到電源部分的電感疊加在一起會報DRC錯誤，請問下這個問題怎么解決?謝謝！
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  g# B1 u# ~: P5 X. B5 g6 Q

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沙發(fā)
發(fā)表于 2017-3-25 13:42:31 | 只看該作者
這個錯誤是器件到器件的錯誤�？梢院雎缘舻�
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發(fā)表于 2017-4-5 09:04:55 | 只看該作者
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發(fā)表于 2022-4-29 09:11:21 | 只看該作者
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