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據說只有大神才知道這個電容的作用

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發(fā)表于 2020-6-18 17:18:16 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
作者 | 劉麗娟(一博科技高速先生團隊隊員)
3 S. U3 @, m  X  _
8 e: ~3 Z" I6 g( k: ?( l0 y- j) {/ k7 r2 X2 ]1 p& e1 Z0 T2 `& r
對于模擬電路沒學好的工程師來說,電阻只知道用來端接;電感只知道用來隔離;至于電容嘛,估計你們只知道濾波,更不用說它們的組合產生的作用了。不信?估計以下這個電容的用法,你也只能說濾波了吧……! `8 x; V; Q( t

; [1 Z- w# h' e, e上周我們雷工,哦不是,是我們姜工的文章向大家介紹了DDR的時鐘里面并聯(lián)電容的用處,讓大家驚奇的發(fā)現了原來電容也可以用來端接,可能已經讓一大把粉絲獲得了一波知識的源泉。那么本期高速先生還繼續(xù)玩這個DDR的時鐘,去深挖它還有什么槽點。" \" [0 n7 u% {

$ s  d+ }. y, Q2 G我們先把上周所講到的這個DDR時鐘的拓撲再一次拉出來,沒錯!就是下面這個圖啦。其中上周讓雷工尷尬不已的這個電容就是下面紅色圈圈的那位了。把電容并聯(lián)到差分對間,能夠很好的對發(fā)送的信號進行端接,目標是使得電容的電抗值和傳輸線接近,從而起到源端端接的效果,減小時鐘的反射。6 w, ^* `/ }% E3 s* D, Q5 W

( N1 H. S* F) p4 V* P' ~
' [7 ]! `4 P# K  G3 A' G& G& ^. t/ E& X  K( A
恩,這個是上篇文章的精華哈。那么我們這期的文章繼續(xù)研究這個拓撲,大家有沒有發(fā)現上面的拓撲其實不止一個電容,看看上圖藍色圈圈的位置,其實還有一個電容哦!它一般是放在最后兩個端接電阻之間,然后下拉到地(也可以上拉到DDR電源)。這個電容到底有什么用呢?根據高速先生對你們的認識,都接到地了,肯定又是用來濾波啦?
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高速先生對此也研究了一番,我們用一個簡單的點對點的時鐘拓撲進行驗證哈。
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7 E( C% d8 T2 N6 S* o& v* F6 J- g" G, J) @" [
如果這對差分線是理想的走線,所謂理想就是差分線的P和N長度一致,阻抗相同,分成對稱的情況下。有無電容的結果是下面這樣的。: ?" U) I+ B6 R6 N, B: c8 o- ~

  |( D% j& a% g7 o0 X2 N' o
8 `$ Z8 v% [8 I7 B- f0 c, g. K4 `. t: u* v0 a' {
是的,如果我們的PCB加工出來就像原理圖設計一樣是理想的情況,那這個電容的確起不了什么作用。但是我們PCB最精彩的地方就在于它的設計和加工的誤差哈。我們知道,對于一對差分線來說,對間P和N的對稱性是最為重要的事情,不然的話它們就是產生共模的噪聲;旧蟻碚f,只要破壞了差分線理想狀態(tài),這對差分線都會或多或少產生共模的噪聲。那么我們在有共模噪聲的情況下再去進行對比驗證,結果就會變得不一樣了。
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( w. Z% U2 i- P3 c& F" g6 \6 J( [  [4 {' t3 E4 A
* |) V7 h  F6 b4 X' |, x# f2 ]
可以看到,沒有了這個電容之后,接收端的波形變得扭曲,甚至是產生了非單調的結果。那么大家也許會問了,那你們怎么知道是不是共模噪聲的影響呢?怎么看呢?
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3 [5 Y; t3 f" Z, R0 n我們可以看下圖紫色箭頭位置的波形,也就是它們產生的共模噪聲的位置了。
. q1 Y, E5 o9 C# ~
: t& j+ ~4 M! S1 b" ^8 O; Q1 u
3 I- [6 p! r' B& d! o5 Q: `$ \) J) S1 F' j
我們可以看到,當差分線有共模噪聲的時候,這個電容其實可以為我們抑制很大部分的噪聲,因此能最大限度的還原接收端信號的完整性。
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5 |2 U  I4 T0 f7 J! p2 L' B4 Z, Z3 ~' K2 G* L
當然如果旁邊的走線離這對時鐘很近的話,有了這個電容,自然也能使得共模噪聲串擾到旁邊走線的能量削弱啦,也就是起到減小串擾的效果。
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沙發(fā)
發(fā)表于 2020-6-28 15:05:44 | 只看該作者
) g9 S6 b: V' `* Q
啥也不說了,感謝樓主分享哇!
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發(fā)表于 2024-8-27 11:35:53 | 只看該作者
感謝樓主分享!
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