常見錯(cuò)誤

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1.原理圖常見錯(cuò)誤:
9 @9 [$ p! K- M& ~9 k(1)ERC報(bào)告管腳沒有接入信號(hào):
a. 創(chuàng)建封裝時(shí)給管腳定義了I/O屬性;
b.創(chuàng)建元件或放置元件時(shí)修改了不一致的grid屬性,管腳與線沒有連上;
c. 創(chuàng)建元件時(shí)pin方向反向,必須非pin name端連線.
(2)元件跑到圖紙界外:沒有在元件庫圖表紙中心創(chuàng)建元件.
(3)創(chuàng)建的工程文件網(wǎng)絡(luò)表只能部分調(diào)入pcb:生成netlist時(shí)沒有選擇為global.
(4)當(dāng)使用自己創(chuàng)建的多部分組成的元件時(shí),千萬不要使用annotate.
! B3 e5 R' ^. o% Y! p: ?4 u% a" T2.PCB中常見錯(cuò)誤:
(1)網(wǎng)絡(luò)載入時(shí)報(bào)告NODE沒有找到:
a. 原理圖中的元件使用了pcb庫中沒有的封裝;
b. 原理圖中的元件使用了pcb庫中名稱不一致的封裝;
! b4 `# V( t' {: R4 Pc. 原理圖中的元件使用了pcb庫中pin number不一致的封裝.如三極管:sch中pin
number 為e,b,c, 而pcb中為1,2,3.
! C2 _0 X% i; f6 A4 y" y: ^8 i8 i(2)打印時(shí)總是不能打印到一頁紙上:
a. 創(chuàng)建pcb庫時(shí)沒有在原點(diǎn);
b. 多次移動(dòng)和旋轉(zhuǎn)了元件,pcb板界外有隱藏的字符.選擇顯示所有隱藏的字符, 縮小
pcb, 然后移動(dòng)字符到邊界內(nèi).
9 E3 b# U& G: \+ }$ l' s(3)DRC報(bào)告網(wǎng)絡(luò)被分成幾個(gè)部分:
表示這個(gè)網(wǎng)絡(luò)沒有連通,看報(bào)告文件,使用選擇CONNECTED COPPER查找.
另外提醒朋友盡量使用WIN2000, 減少藍(lán)屏的機(jī)會(huì);多幾次導(dǎo)出文件,做成新的DDB文件,
, V/ r, E# }/ M, g) N減少文件尺寸和PROTEL僵死的機(jī)會(huì).如果作較復(fù)雜得設(shè)計(jì),盡量不要使用自動(dòng)布線.

在pcb設(shè)計(jì)中,布線是完成產(chǎn)品設(shè)計(jì)的重要步驟,可以說前面的準(zhǔn)備工作都是為它而做的,
在整個(gè)PCB中,以布線的設(shè)計(jì)過程限定最高,技巧最細(xì)、工作量最大.PCB布線有單面布
1 B5 Y7 f& e7 d$ @線、 雙面布線及多層布線.布線的方式也有兩種:自動(dòng)布線及交互式布線,在自動(dòng)布線之
前, 可以用交互式預(yù)先對(duì)要求比較嚴(yán)格的線進(jìn)行布線,輸入端與輸出端的邊線應(yīng)避免相鄰
& P1 G2 w' q8 \1 y: W平行, 以免產(chǎn)生反射干擾.必要時(shí)應(yīng)加地線隔離,兩相鄰層的布線要互相垂直,平行容易
產(chǎn)生寄生耦合.
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自動(dòng)布線的布通率,依賴于良好的布局,布線規(guī)則可以預(yù)先設(shè)定, 包括走線的彎曲次數(shù)、
$ y4 ?, I  I5 |- h: ~導(dǎo)通孔的數(shù)目、步進(jìn)的數(shù)目等.一般先進(jìn)行探索式布經(jīng)線,快速地把短線連通, 然后進(jìn)行
迷宮式布線,先把要布的連線進(jìn)行全局的布線路徑優(yōu)化,它可以根據(jù)需要斷開已布的線.
* M3 I1 L, b' y9 I6 `- Y并試著重新再布線,以改進(jìn)總體效果.

對(duì)目前高密度的PCB設(shè)計(jì)已感覺到貫通孔不太適應(yīng)了, 它浪費(fèi)了許多寶貴的布線通道,為解
決這一矛盾,出現(xiàn)了盲孔和埋孔技術(shù),它不僅完成了導(dǎo)通孔的作用, 還省出許多布線通道
3 V( B% `$ t$ z9 x6 V使布線過程完成得更加方便,更加流暢,更為完善,PCB 板的設(shè)計(jì)過程是一個(gè)復(fù)雜而又簡單
的過程,要想很好地掌握它,還需廣大電子工程設(shè)計(jì)人員去自已體會(huì), 才能得到其中的真
諦.
4 V. j% Q9 |1 ]# l詳情可見www.sz-jlc.com/s
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