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[作業(yè)已審核] 邱馳-第二十次作業(yè)-DDR3T型PCB設(shè)計

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發(fā)表于 2024-7-7 18:19:35 | 只看該作者 |只看大圖 回帖獎勵 |倒序瀏覽 |閱讀模式
本次作業(yè)難點主要在BGA出線，線拉通了，就簡單了。

DDRX2_0707.zip

471.29 KB, 下載次數(shù): 1, 下載積分: 聯(lián)盟幣 -5

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發(fā)表于 2024-7-12 15:42:40 | 只看該作者
這個距離過近了，導(dǎo)致中間走線繞等長空間不夠

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板凳
發(fā)表于 2024-7-12 15:43:45 | 只看該作者
短路的DRC要處理一下


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地板
發(fā)表于 2024-7-12 15:44:47 | 只看該作者
vref走線不能走在電源層。這樣ddr的主電源就被分割亂了


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5#
發(fā)表于 2024-7-12 15:45:41 | 只看該作者
都沒聯(lián)通


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6#
發(fā)表于 2024-7-12 15:46:46 | 只看該作者
能滿足3W的位置要修3W，不是搞個區(qū)域規(guī)則了事





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發(fā)表于 2024-7-29 02:38:48 | 只看該作者
cesc 發(fā)表于 2024-7-12 15:46
能滿足3W的位置要修3W，不是搞個區(qū)域規(guī)則了事

啊這，沒修完
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