電子產(chǎn)業(yè)一站式賦能平臺(tái)

PCB聯(lián)盟網(wǎng)

搜索
查看: 1233|回復(fù): 0
收起左側(cè)

基于Vivado的程序下載

[復(fù)制鏈接]

678

主題

902

帖子

8293

積分

高級(jí)會(huì)員

Rank: 5Rank: 5

積分
8293
跳轉(zhuǎn)到指定樓層
樓主
發(fā)表于 2020-6-30 11:18:50 | 只看該作者 回帖獎(jiǎng)勵(lì) |倒序?yàn)g覽 |閱讀模式
Vivado下bit文件下載步驟6 }! y( W& ]& S  G
將電源、下載器與板卡連接,打開(kāi)Vivado工程,參考《基于TcL腳本生成Vivado工程及編譯》文檔編譯工程,生成對(duì)應(yīng)的bit文件。
打開(kāi)板卡電源開(kāi)關(guān),找到右下角的”O(jiān)pen Hardware Manager”展開(kāi),右擊”O(jiān)pen Target”彈出一個(gè)小窗口,右擊”Auto Connect”選項(xiàng)。

# C0 Q0 r' ]. I8 x, E- t8 D: j9 Q" b
等待Vivado識(shí)別對(duì)應(yīng)的板卡。

( f8 h" V1 M% U+ u7 L* |* E
右擊xc7z020_1彈出一個(gè)窗口,再點(diǎn)擊”P(pán)rogram Device…”。

4 R3 D  p6 R, i4 C: c
在彈出窗口”Bitstream file”欄選擇編譯生成的bit文件(工程編譯完成后自動(dòng)選擇對(duì)應(yīng)的bit文件),右擊Program開(kāi)始燒寫(xiě)bit文件。

7 q9 j0 `! U! I1 w$ A
等待燒寫(xiě)完成。
) j/ X8 ~* h( b
使能PS-PL Voltage Level Shifter寄存器' |5 Z" X' K) V# p
若例程中使用PS端FCLK作為PL端系統(tǒng)時(shí)鐘信號(hào),PS端與PL端在上電過(guò)后需要通過(guò)使能PS-PL電壓電平轉(zhuǎn)換寄存器,才能使用FCLK。Xilinx官方文檔ug585中”2.4 PS–PL Voltage Level Shifter Enables”章節(jié)有詳細(xì)說(shuō)明。修改方法參考以下步驟操作。
; H) t, p: Q: m, S& A2 a
Linux系統(tǒng)通過(guò)串口調(diào)試終端修改
7 t) s: W& l( F  @$ Z  b( h% W
開(kāi)發(fā)板上電,SD啟動(dòng)后,先加載bit文件配置好PL端,然后在PS串口調(diào)試終端輸入下面命令使能PS-PL電壓電平轉(zhuǎn)換寄存器。
Target# devmem 0xf8000900 w 0xf

- {0 V0 _8 R' `) f7 c! H
Xilinx SDK通過(guò)下載器修改
; d) b) w' i0 F: ^
打開(kāi)Xilinx SDK,點(diǎn)擊”Run->Run Configuration”,在配置界面勾選”Run ps7_post_config”,確認(rèn)需要加載的bit文件,然后點(diǎn)Run。

3 r+ ~3 W& I3 o) \" h7 i
也可以在debug后,通過(guò)Memory窗口修改0xf8000900寄存器的值為0xF,使能PS-PL電壓電平轉(zhuǎn)換寄存器。
. N4 S4 l5 J. I# a; \9 N% ^
嵌入式DSP、ARM、FPGA多核技術(shù)開(kāi)發(fā),學(xué)習(xí)資料下載:http://site.tronlong.com/pfdownload

發(fā)表回復(fù)

本版積分規(guī)則


聯(lián)系客服 關(guān)注微信 下載APP 返回頂部 返回列表