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串行高速信號完整性仿真分析

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發(fā)表于 2013-8-4 19:55:38 | 只看該作者 回帖獎勵 |倒序?yàn)g覽 |閱讀模式

華為網(wǎng)盤附件:
【華為網(wǎng)盤】 高速信號完整性工程師培訓(xùn)認(rèn)證課程.-Serdes.pdf
(3.04M)
高速串行信號完整性仿真分析關(guān)心以下幾點(diǎn):
1、抖動是高速信號永遠(yuǎn)的主題,而且很難控制
2、過孔優(yōu)化,使過孔對信號的影響最小
3、AC 耦合電容,信號遇到AC 耦合電容必定會造成阻抗不連續(xù)
4、高速連接器的接口也會造成阻抗不連續(xù)
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發(fā)表于 2013-8-7 16:32:02 | 只看該作者
看帖子的要發(fā)表下看法

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發(fā)表于 2013-8-7 16:50:47 | 只看該作者
一直在尋找的資料,非常有用

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發(fā)表于 2013-8-7 20:35:55 | 只看該作者
今茲捧袂 發(fā)表于 2013-8-7 16:32
看帖子的要發(fā)表下看法

高速串行信號完整性仿真分析關(guān)心以下幾點(diǎn):
1、抖動是高速信號永遠(yuǎn)的主題,而且很難控制
2、過孔優(yōu)化,使過孔對信號的影響最小
3、AC 耦合電容,信號遇到AC 耦合電容必定會造成阻抗不連續(xù)
4、高速連接器的接口也會造成阻抗不連續(xù)
這就是看法

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發(fā)表于 2013-8-8 19:28:50 | 只看該作者
必須支持。。。。。。。
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發(fā)表于 2013-8-9 13:59:00 | 只看該作者
樓主對仿真 研究的不錯嘛!
該會員沒有填寫今日想說內(nèi)容.

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發(fā)表于 2013-8-16 21:36:30 | 只看該作者
不錯!頂LZ

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發(fā)表于 2013-8-20 17:56:49 | 只看該作者
應(yīng)該是不錯的資料呢

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發(fā)表于 2013-8-29 12:45:52 | 只看該作者
說到Serdes,不得不說AMI模型,可以設(shè)置“預(yù)加重”、“去加重”、“均衡”。當(dāng)接收端測試發(fā)現(xiàn)過沖太大,可以設(shè)置“去加重”,當(dāng)接收端測試發(fā)現(xiàn)眼圖張不開時,可設(shè)置“預(yù)加重”!邦A(yù)加重”、“去加重”都用于發(fā)射器,“均衡”則在接收器使用。

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發(fā)表于 2013-9-2 15:49:04 | 只看該作者
謝謝樓主 分享

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