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[PCB技術(shù)] Cadence Allegro Orcad繪制原理圖時(shí),對(duì)某些屬性隱藏或者顯示應(yīng)該怎么處理呢?

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發(fā)表于 2021-3-24 16:52:14 | 只看該作者 |只看大圖 回帖獎(jiǎng)勵(lì) |正序?yàn)g覽 |閱讀模式
Cadence allegro orcad繪制原理圖時(shí),對(duì)某些屬性隱藏或者顯示應(yīng)該怎么處理呢?
答:我們?cè)诶L制原理圖的時(shí)候,總會(huì)有很多參數(shù)出現(xiàn)在原理圖中。有時(shí)候我們想對(duì)某些參數(shù)進(jìn)行隱藏,對(duì)某些參數(shù)進(jìn)行顯示,具體應(yīng)該怎么做呢?我們舉一個(gè)簡(jiǎn)單的例子來(lái)進(jìn)行描述原理圖屬性隱藏或者顯示的方法,其它屬性也是一樣的方法,對(duì)其進(jìn)行舉一反三就好,操作的方法與步驟都是一模一樣的。
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謝謝分享,辛苦了

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