Cadence Allegro在進(jìn)行高速信號設(shè)計(jì)的時(shí)候如何進(jìn)行進(jìn)行無盤設(shè)計(jì)呢？

嘻嘻哈哈123 · 發(fā)表于 2021-4-27 11:42:31

Cadence allegro在進(jìn)行高速信號設(shè)計(jì)的時(shí)候如何進(jìn)行進(jìn)行無盤設(shè)計(jì)呢？

答：做無盤設(shè)計(jì)的目的，是因?yàn)橥ǹ椎暮副P在內(nèi)電層，是具有寄生電容的效應(yīng)的，容易造成阻抗的不連續(xù)，導(dǎo)致信號出現(xiàn)發(fā)射，從而影響信號的完整性，所以在處理高速信號時(shí)候，在PCB設(shè)計(jì)端就將走線連接層的焊盤去掉，最大程度的保持地過孔與通孔連接處的走線阻抗一致，具體操作的步驟如下所示：

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