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[已解答問(wèn)題] 在原理圖導(dǎo)入到PCB中的時(shí)候顯示Unkonwpin，怎么解決

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發(fā)表于 2016-8-16 17:16:29 | 只看該作者 |只看大圖 回帖獎(jiǎng)勵(lì) |倒序?yàn)g覽 |閱讀模式


技術(shù)支持 官方 QQ 群： 547971984 技術(shù)論壇： qmagazine.cn
該會(huì)員沒(méi)有填寫今日想說(shuō)內(nèi)容.

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發(fā)表于 2016-8-16 17:19:24 | 只看該作者
出現(xiàn)此類情況有三種原因，
第一個(gè)，你原理圖沒(méi)有填寫封裝名稱，請(qǐng)雙擊，在此處按Add進(jìn)行添加，如圖所示


第二種原因，你封裝路徑?jīng)]有匹配，封裝管理處，匹配路徑

第三種原因，PCB封裝腳位和原理圖腳位無(wú)法對(duì)上，比如一個(gè)MOS管  原理圖腳位定義是G  S D    而封裝SOT23  腳位定義是  1  2 3   這時(shí)候是無(wú)法匹配識(shí)別的


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發(fā)表于 2016-8-16 17:32:00 | 只看該作者
可以把這個(gè)加上是  ：因?yàn)樵韴D中的很多網(wǎng)絡(luò)已經(jīng)更新到PCB了 ，打開(kāi)你創(chuàng)建的PCB,  design里選netlist，edit net  把里面已經(jīng)存在的網(wǎng)絡(luò)都刪除了，再?gòu)脑韴D重新update就可以了

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發(fā)表于 2016-11-14 21:47:40 | 只看該作者
試試不知道行不行~~

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發(fā)表于 2016-8-16 19:52:47 | 只看該作者
這個(gè)是什么原因呢？

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發(fā)表于 2016-9-2 08:40:26 | 只看該作者
Phelps 發(fā)表于 2016-8-16 03:52
這個(gè)是什么原因呢？

這個(gè)是加總線失敗了  需要更新原理圖
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發(fā)表于 2016-9-2 08:43:40 | 只看該作者
nange 發(fā)表于 2016-8-16 01:32
可以把這個(gè)加上是  ：因?yàn)樵韴D中的很多網(wǎng)絡(luò)已經(jīng)更新到PCB了 ，打開(kāi)你創(chuàng)建的PCB,  design里選netlist，edi ...

無(wú)法識(shí)別的是沒(méi)辦法導(dǎo)入 應(yīng)該不是這個(gè)原因
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發(fā)表于 2016-11-2 20:23:05 | 只看該作者
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發(fā)表于 2016-11-27 14:21:56 | 只看該作者
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發(fā)表于 2016-12-21 08:22:40 | 只看該作者
來(lái)論壇看下，可以學(xué)到新技能。

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