Cadence Allegro什么是層次式電路設(shè)計(jì)，它的優(yōu)點(diǎn)有哪些呢？

嘻嘻哈哈123 · 發(fā)表于 2021-3-23 16:03:14

Cadence allegro什么是層次式電路設(shè)計(jì)，它的優(yōu)點(diǎn)有哪些呢？

答：層次式電路設(shè)計(jì)（Hierarchical Design），通常是在設(shè)計(jì)比較復(fù)雜的電路和系統(tǒng)時采用的一種自上而下的電路設(shè)計(jì)方法，即首先在一張圖紙上設(shè)計(jì)電路總體框圖，然后再在另外層次圖紙上設(shè)計(jì)每個框圖代表的子電路結(jié)構(gòu)，下一層次中還可以包括框圖，按層次關(guān)系將子電路框圖逐級細(xì)分，直到最低層次上為具體電路圖，不再包括子電路框圖，如圖3-107所示，是一個大概的層次式原理圖的框架。

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