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[Cadence] 16層設(shè)計(jì) Xilinx官方FPGA板 Kintex UltraScale FPGA KCU105+4片DDR4

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發(fā)表于 2020-7-2 23:15:17 | 只看該作者
挺想看的，這些資料太少了，給設(shè)計(jì)造成不少的麻煩

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發(fā)表于 2020-7-3 08:31:30 | 只看該作者
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發(fā)表于 2020-8-13 15:42:16 | 只看該作者

感謝樓主分享，頂頂頂頂頂頂！

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發(fā)表于 2020-8-13 16:28:12 | 只看該作者
頭回見(jiàn)到16層板，厲害�。�

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發(fā)表于 2020-9-21 21:17:05 | 只看該作者
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發(fā)表于 2020-9-22 09:23:13 | 只看該作者
嘻嘻嘻嘻嘻嘻嘻嘻嘻嘻嘻嘻

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發(fā)表于 2020-9-22 21:21:43 | 只看該作者
哼唧唧哼唧唧哼唧唧哼唧唧哼唧唧哼唧唧哼唧唧

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發(fā)表于 2020-9-22 21:23:31 | 只看該作者
哈哈哈哈哈哈哈哈哈

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發(fā)表于 2020-9-22 21:44:55 | 只看該作者
xiexiefenxiang

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發(fā)表于 2020-9-22 23:45:55 | 只看該作者
謝謝分享謝謝分享

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