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使用Sigrity進(jìn)行走線阻抗與耦合度檢查

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發(fā)布時(shí)間: 2019-11-18 23:13

正文摘要:

layout中對(duì)于走線最基礎(chǔ)的關(guān)注點(diǎn)是阻抗和串?dāng)_。對(duì)于阻抗，在開始設(shè)計(jì)PCB之前，我們會(huì)計(jì)算出滿足阻抗要求的單端走線以及差分線等。對(duì)于串?dāng)_則是通過設(shè)置走線與走線之間的間距。這兩者我們都會(huì)在設(shè)計(jì)的時(shí)候?qū)?shù)填寫 ...

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zhzh0902 發(fā)表于 2023-9-12 09:01:55
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px0072 發(fā)表于 2022-9-29 15:04:16
感謝分享   
px0072 發(fā)表于 2022-9-26 15:39:49
謝謝分享，學(xué)習(xí)學(xué)習(xí)
lintingni 發(fā)表于 2020-1-16 20:48:28
學(xué)習(xí)學(xué)習(xí)，樓主威武

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