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本帖最后由 凡人1900 于 2023-7-11 18:38 編輯
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! f+ {6 B, U8 p# H- O; i9 J% v: _9 u1 { m2 J$ {$ S
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7 y b( z' _, T! G0 j4 v' eAltium designer19使用幾個疑問之五（一直用pads，知道的不吝賜教，謝謝。不愿意說的煩請繞道）一張張圖片上傳太浪費時間，就壓縮了一個包了，我的疑問都在里面，圖文并茂，下載解壓很快
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1.綠色的邊框怎么比板框都大更邊緣6 e7 D9 V; Y* [4 F
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2.PCB高亮網(wǎng)絡之后原理圖不會同步高亮
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3.差分等長設置 右下角那個5mil值是什么含義% k: e( G5 V$ N5 s/ ~) {, A
, H( u, ?8 ?- y$ l) p4.差分等長設置對不對？+ X7 O m, T" F
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5.差分線線寬已經(jīng)調(diào)細了，只有5mil 但是拉出來的線還是不美觀也不符合要求
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6.畫等長用的是這個菜單工具& {% [1 }4 n! {3 I# g0 O+ Z
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7.已經(jīng)設置好了差分線規(guī)則
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8.這差分線怎么畫的那么別扭，我看一畫基本是成為這種是大概率
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9.這種差分走線也不美觀5 y/ F) O D" k3 D4 E
# b9 |: |" Q. y9 ?; G& X2 o10.最開始的時候線寬較寬，這種差分線也是不對的" p+ |1 G& C; v7 a* w# _" ~
! o ]6 U# ]6 Z2 c6 G$ Z; T# w11.原理圖網(wǎng)絡標號和差分對的名稱label值保持一致update才不會報錯？操作的時
6 v* Y0 ^" g* o% l0 Z' L/ A, Z) k
7 ~& p [) l/ I* K! v9 K候確實是那樣，如果網(wǎng)絡名和差分的Lable名稱不一樣，就會報錯
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12.選擇位號 按AP 放不到想要的位置9 o! p+ K+ g3 {* w7 O1 h
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13.隱形的透明框是過孔的什么框？是怎么設置的？如果刪除 所有的過孔都沒了( m9 G( n2 t6 s
; E. @8 ^) s3 T4 F$ o! b0 e14.AD很容易把元件刪了 有沒有像pads的開關 沒有關閉DRC是不可能刪掉元件的。在哪里可以設置
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( [& u' T, G. x3 I15.考慮空間不夠 就把線寬設細了 如圖是最終的規(guī)則設置 S' C3 {; `0 |; |2 F3 G
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差分線+等長線參考這個帖子畫的& A1 x9 h/ j0 P- {1 S3 x
+ K8 r; u1 A0 e5 B, R9 shttps://blog.csdn.net/qq_36720691/article/details/124870440
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