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PCB抗ESD的設(shè)計(jì)原則

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發(fā)表于 2017-2-22 17:46:57 | 只看該作者 回帖獎(jiǎng)勵(lì) |倒序?yàn)g覽 |閱讀模式
2 S* b: X/ r+ ]9 P% x% u! S
ESD(Electro-Static discharge),即靜電釋放。靜電是自然現(xiàn)象,其特點(diǎn)是長(zhǎng)時(shí)間積聚、高電壓、低電量、小電流和作用時(shí)間短等。人體接觸、物體摩擦、電器間的感應(yīng)等,都會(huì)產(chǎn)生靜電,電子產(chǎn)品基本上都處于ESD的環(huán)境之中。ESD一般不會(huì)直接損壞電子產(chǎn)品,但卻會(huì)對(duì)其造成干擾,會(huì)導(dǎo)致設(shè)備鎖死、信號(hào)干擾、數(shù)據(jù)丟失等。故此,電子產(chǎn)品必須做好抗ESD,PCB作為電子產(chǎn)品的基本器件,也不可忽視。3 o6 o5 r" I5 `: }- B
那么,PCB在設(shè)計(jì)、生產(chǎn)過(guò)程中,應(yīng)該如何抗ESD呢?金 百澤給大家簡(jiǎn)單介紹:" [, a6 \5 r/ c& r! K
首先在電路設(shè)計(jì)上,應(yīng)當(dāng)減少環(huán)路面積。因?yàn)榄h(huán)路具有變化的磁通量,電流的幅度與環(huán)的面積成正比,環(huán)路越大,則磁通量越大,則就能感應(yīng)出越強(qiáng)的電流。故環(huán)路面積越小,能夠感應(yīng)到的靜電電流越小。0 h+ y6 z0 B* p  h5 u
其次,盡量使用多層PCB,因?yàn)槎嗝鍼CB的地平面、電源平面、信號(hào)線、地線的間距可以減小工模阻抗和感性耦合,從而減少ESD。
+ j3 n& s7 F; v6 c9 L, `/ K第三,盡量使用較短的信號(hào)線,因?yàn)殚L(zhǎng)的信號(hào)線可以接收ESD脈沖能量。盡量把每個(gè)信號(hào)層緊靠著相應(yīng)的電源層或地線層。如果元器件比較密集,可以使用內(nèi)層線。  ^9 G2 I4 x$ ]  u7 Y5 D
第四,如果PCB周圍畫出不加組焊層的走線,可以將走線連接至外殼,但不能構(gòu)成一個(gè)封閉的環(huán),以免形成環(huán)形天線而引入更大的麻煩。4 Y3 x4 j! g$ y% H0 W& u
第五,可以采用有鉗位二極管的CMOS器件或者TTL器件保護(hù)電路,有了鉗位二極管的保護(hù),在實(shí)際電路設(shè)計(jì)中減小了設(shè)計(jì)的復(fù)雜度。

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發(fā)表于 2017-2-22 21:15:52 | 只看該作者
靜電的基本知識(shí),學(xué)學(xué),非常有幫助,謝謝分享
板凳
發(fā)表于 2017-2-22 22:27:00 | 只看該作者
接觸放電比較好整,空氣放電就麻煩很多

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發(fā)表于 2017-2-23 13:56:35 | 只看該作者
謝謝樓主分享大家

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發(fā)表于 2020-6-17 11:57:30 | 只看該作者
基本知識(shí),還希望更多點(diǎn)

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發(fā)表于 2020-7-8 08:47:32 | 只看該作者
# ~. l; i3 [' v: A
金幣不足,只能先灌水了,發(fā)現(xiàn)竟然是免費(fèi)的

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