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[已解答問題] PCB檢查時報錯,提示Un-Routed Net Constraint,但明明已經(jīng)連接上了

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發(fā)表于 2018-7-24 21:21:37 | 只看該作者 |只看大圖 回帖獎勵 |倒序瀏覽 |閱讀模式
PCB 進行design rule check 時報錯,提示Un-Routed Net Constraint: Net V_VS Between Track (33.223mm,-13.425mm)(34.781mm,-13.425mm) on Bottom Layer And Pad R85-2(33.236mm,-11.848mm) on Bottom Layer,   但是明明已經(jīng)連上了


333333333333333.jpg (138.81 KB, 下載次數(shù): 72)

PCB 規(guī)則檢查時報錯

PCB 規(guī)則檢查時報錯
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發(fā)表于 2018-7-31 17:21:25 | 只看該作者
你先把底層那一段導線刪除掉,放大看是否有一根很細很細的線?蜻x后進行刪除操作,再DRC檢查一下。很有可能是這個原因,
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發(fā)表于 2018-8-3 17:40:42 | 只看該作者
這是AD17的BUG  確認連接好了沒問題就不用管了
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發(fā)表于 2021-4-12 23:41:42 來自手機 | 只看該作者
為什么我一滴淚就有這個錯誤,是哪方面做的不好導致的呢?
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發(fā)表于 2023-5-31 16:50:48 | 只看該作者
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發(fā)表于 2024-6-11 09:58:11 | 只看該作者
我也遇到了同樣的問題,附近應(yīng)該有條很細的線,刪了之后就好了
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